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Un test de la HiFive Unmatched de chez SiFIve, ou le souci actuel du RISC-V

Le RISC-V, c’est un jeu d’instruction libre de droits qui, en théorie, est bourré d’avantages. Entre la fin des querelles juridiques et la possibilité de s’intégrer aisément dans un écosystème libre plus ou moins complet, cette ISA fait de l’œil à bon nombre de firmes. Dans cette série, SiFive est un ancien qui propose un bon nombre de puces, allant des basses consommation de la série E aux accélérateurs de machine learning telle l’Intelligence X280, en passant par notre trublion du jour, le FU740.

 

Testé chez nos confrères de Phoronix, le SoC comprend 4 cœurs SiFive U74 « haute performance » accompagnée d’un cœur SiFive S7 plus petit. Le tout est soudé sur une carte de développement possédant 16 Gio de RAM et un port PCIe 3.0 x16 (x8 en interne), compatible notamment avec les cartes AMD (merci au driver intégré au noyau !) limitées aux séries Radeon HD 5000 — à ne pas confondre avec les RX 5000 ! – et les RX série 500. Rajoutez l’Ethernet Gigabit, un slot M.2 NVMe pour SSD, un autre pour le WiFi/Bluetooth, 4 ports USB 3.2 gen 1 et un emplacement microSD : de quoi sur le papier proposer un produit tout à fait convenable ?

 

logo intel sifive inside cdh

 
 
Hélas, voilà qui est loin d’être le cas. Si les seules entrées et sorties étaient caractéristiques d’un bon PC, cela se saurait ! Avec dans le meilleur des cas la moitié des performances du Raspberry Pi 400, celui intégré dans un clavier, aux performances légèrement supérieures à la version classique dans sa quatrième mouture (car équipé d’un quadricore Cortex-A72 @ 1,8 GHz). Rajoutez un tarif de 665 $ (production limitée sur un tel facteur de forme oblige), et voilà que la bête se retrouve coincée sur le segment des entreprises souhaitant développer des produits ou solutions maison à base de RISC-V, mais clairement pas pour le grand public. Autant dire que le chemin est encore long vers une solution compétitive déployable à grande échelle, ne serait-ce que face à ARM.
 
Un poil avant ?

Le SSD SATA n'est toujours pas mort, le MX500 de Crucial passe (enfin) à 4 To

Un peu plus tard ...

Nous avons essayé • Les Arctic P12 Slim PWM PST et BioniX P120 A-RGB

Les 8 ragots
Les ragots sont actuellement
ouverts à tous, c'est open bar !
par Kannagi en Provence-Alpes-Côte d'Azur, le Vendredi 08 Octobre 2021 à 08h33  
par burbigo3 le Jeudi 07 Octobre 2021 à 01h46
Franchement, ça ne m'étonne pas que ça fasse un travail excellent
Pourquoi cela ?
Un proc qui à 20 ans de retard d'un point de vue techno ne t'étonne pas ?
par Kannagi en Provence-Alpes-Côte d'Azur, le Vendredi 01 Octobre 2021 à 18h49  
Oui vraiment les perfs me semble miraculeuse vu le processeur ,donc le compilo doit faire un sacré bon boulot.
par Un ragoteur RGB en Île-de-France, le Vendredi 01 Octobre 2021 à 14h41  
par Kannagi en Provence-Alpes-Côte d'Azur le Vendredi 01 Octobre 2021 à 05h22
Pareil assez étonné des perfs vu l'architecture du machin , c'est un processeur in-order assez léger , son architecture est ce qu'on faisait déjà depuis 20 ans sur du MIPS a peu près.

Apres pour le compilo à voir , bon par expérience , 8 étages, probablement une latence de 5-6 cycles, ça me semble coton à optimiser '
Après réflexions, je pense que le compilateur doit déjà avoir un certain nombre d'optimisations déjà faites pour l'architecture, qui sont communes à beaucoup de processeurs, comme tu le dit.
D'où les "bonnes" performances. En tout cas, je leur souhaite du succès !
par Kannagi en Provence-Alpes-Côte d'Azur, le Vendredi 01 Octobre 2021 à 05h22  
Pareil assez étonné des perfs vu l'architecture du machin , c'est un processeur in-order assez léger , son architecture est ce qu'on faisait déjà depuis 20 ans sur du MIPS a peu près.

Apres pour le compilo à voir , bon par expérience , 8 étages, probablement une latence de 5-6 cycles, ça me semble coton à optimiser '
par Un adepte de Godwin en Auvergne-Rhône-Alpes, le Mercredi 29 Septembre 2021 à 19h12  
par Nicolas D. le Mercredi 29 Septembre 2021 à 16h15
Vu que c'est du RISC, je m'attends à ce qu'une partie des passes d'opti déjà en place soit efficaces, et que le boulot d'optimisation spécifique soit limité (typiquement la codegen, il ne doit pas y avoir tant de façon de la faire sur un RISC).
Oui, et non. Le processeur est in-order et a pipeline à 8 étages : un petit lien tout mignon
Il y a donc matière à optimiser le code généré pour ce processeur (mais c'est spécifique à une micro-architecture donnée).
Cependant, il faudra pas en attendre des miracles : le design du processeur est hyper-basique, avec très peu d'unités d'exécutions, pas d'exécution out-order, une hiérarchie mémoire clairement légère, etc.
Je suis en fait étonné des bons résultats. Ils sont sans doute en train de travailler à transformer l'essai, et rattraper les cores ARM.
par Nicolas D., le Mercredi 29 Septembre 2021 à 16h15  
par Un ragoteur qui draille de Bretagne le Mercredi 29 Septembre 2021 à 14h32
C'est surtout le tout début... il manque tout, et surtout les optimisations des compileurs.

Pour un premier jet, moi je dis pas mal et prometteur. Ca va booster la communauté des libristes dessus. Manque plus qu'une carte à qq dizaines d'euro, max 100€ et ça va décoller.
Clairement, mais là c'est 650 à 100 le verdict aurait pas du tout été le même. Les optimisations des compilos, pourquoi pas mais je garde des réserve. La plupart des optimisations sont effectuées au niveau de la représentation intermédiaire (IR) qui est commune quelle que soit ton langage de prog et ton assembleur. Vu que c'est du RISC, je m'attends à ce qu'une partie des passes d'opti déjà en place soit efficaces, et que le boulot d'optimisation spécifique soit limité (typiquement la codegen, il ne doit pas y avoir tant de façon de la faire sur un RISC).
par Un ragoteur qui draille de Bretagne, le Mercredi 29 Septembre 2021 à 14h32  
C'est surtout le tout début... il manque tout, et surtout les optimisations des compileurs.

Pour un premier jet, moi je dis pas mal et prometteur. Ca va booster la communauté des libristes dessus. Manque plus qu'une carte à qq dizaines d'euro, max 100€ et ça va décoller.
par Edenar, le Mercredi 29 Septembre 2021 à 10h50  
Bon c'est sûr que proposer entre 20% et 50% des perfs d'un clavier avec un soc arm minable dedans ça fait pas rêver mais comme dit l'article :
"It will be interesting to repeat these benchmarks over the months ahead to see how much of the Raspberry Pi's upperhand is from the hardware/SoC or of the still evolving RISC-V Linux support. Some of these benchmarks do have x86/x86_64 and ARM/AArch64 optimizations where it's still rather rare to see RISC-V specific optimizations by different open-source/Linux projects. "

Ya plus qu'à espérer !